可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計(jì)應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語(yǔ)言與源代碼、FPGA開(kāi)發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
基于FPGA和處理器的集成式電源管理方案
該解決方案在單芯片IC上集成多個(gè)開(kāi)關(guān)穩(wěn)壓器、LDO和監(jiān)控/看門狗定時(shí)器,由于機(jī)器視覺(jué)系統(tǒng)的尺寸不斷變小，而這些系統(tǒng)的處理能力持續(xù)飛速增長(zhǎng)，電源管理正進(jìn)一步成為新機(jī)器視覺(jué)系統(tǒng)的重要...
2017-11-18 標(biāo)簽：開(kāi)關(guān)穩(wěn)壓器ADP5034開(kāi)關(guān)穩(wěn)壓器 1749
基于DM648的圖像處理邏輯設(shè)計(jì)與實(shí)現(xiàn)
介紹了一種基于DM648和FPGA構(gòu)架的圖像處理方案，闡述了圖像處理模塊的組成原理和結(jié)構(gòu)，并對(duì)模塊內(nèi)部電路設(shè)計(jì)和FPGA內(nèi)部圖像處理邏輯進(jìn)行了重點(diǎn)介紹。木文設(shè)計(jì)的圖像處理模塊能夠支持對(duì)高...
基于FPGA和PWM的多路信號(hào)發(fā)生器設(shè)計(jì)
基于運(yùn)放的信號(hào)發(fā)生器精度低且穩(wěn)定性和可調(diào)節(jié)性差，而基于DDS的信號(hào)發(fā)生器則成本高、電路復(fù)雜。為此提出了基于FPGA+PWM的多路信號(hào)發(fā)生器設(shè)計(jì)方法。該方法硬件上無(wú)需DAC與多路模擬開(kāi)關(guān)，由...
2017-11-18 標(biāo)簽：PWM信號(hào)發(fā)生器PWMxc3s100e信號(hào)發(fā)生器 7696
基于FPGA多波束成像的聲納系統(tǒng)設(shè)計(jì)
給出了一種基于FPGA的多波束成像聲納整機(jī)的硬件電路設(shè)計(jì)方案，介紹了該方案中各分系統(tǒng)的具體電路實(shí)現(xiàn)，以Xilinx公司的FPGA芯片作為核心器件，根據(jù)干端PC下發(fā)的控制指令實(shí)現(xiàn)對(duì)180個(gè)基元的發(fā)...
2017-11-18 標(biāo)簽：FPGAxc6vlx550t 5011
QuickBoot基礎(chǔ)知識(shí)與在FPGA邏輯遠(yuǎn)程更新的應(yīng)用
對(duì)于成熟的電子產(chǎn)品，高效穩(wěn)定的工作是非常重要的一項(xiàng)指標(biāo)。而一款剛推向市場(chǎng)的產(chǎn)品則需要研發(fā)人員或者技術(shù)維護(hù)人員進(jìn)行必要的維護(hù)或者更新，以求達(dá)到更穩(wěn)定的效果。對(duì)于FPGA的邏輯更...
2017-11-18 標(biāo)簽：FPGA 9686
基于ZYNQ SOC的電機(jī)控制及實(shí)例分析
工業(yè)設(shè)計(jì)人員可以利用快速原型與基于模型的設(shè)計(jì)將電機(jī)控制算法移至Zynq SoC環(huán)境。 自20世紀(jì)90年代以來(lái)，電機(jī)驅(qū)動(dòng)開(kāi)發(fā)人員一直采用多芯片架構(gòu)實(shí)施電機(jī)控制與處理需求。 在這種架構(gòu)中，離散...
利用Xilinx FPGA 集成的萬(wàn)兆MAC IP 核以及XAUI IP 核實(shí)現(xiàn)FPGA 片間可靠通信設(shè)計(jì)
隨著云計(jì)算技術(shù)的發(fā)展，采用FPGA 作為協(xié)同加速成為其發(fā)展的一個(gè)趨勢(shì)，如何設(shè)計(jì)與實(shí)現(xiàn)FPGA 片間的高速通信是該研究方向的一個(gè)熱點(diǎn)。研究了FPGA 萬(wàn)兆通信的物理層、MAC 層的實(shí)現(xiàn)機(jī)制，在通信...
NI VST FPGA軟件編程使用步驟與實(shí)例教程
本文介紹 NI VST FPGA軟件包含多層代碼，提供了從底層控制到高層抽取的一切，擁有RF信號(hào)分析儀和RF信號(hào)發(fā)生器的功能。底層組件實(shí)現(xiàn)了具體硬件的標(biāo)準(zhǔn)功能，包括信號(hào)校準(zhǔn)、前端控制，以及基...
NI LabVIEW Real - Time和Microsoft Windows Embedded Standard7三大問(wèn)題突顯性能對(duì)比
為了滿足您的部署需要，NI提供了兩種嵌入式操作系統(tǒng)：NI LabVIEW Real - Time和Microsoft Windows Embedded Standard7（WES7）。每種操作系統(tǒng)對(duì)于不同的任務(wù)和操作具有不同的優(yōu)勢(shì)。 LabVIEW Real-Time保證了關(guān)鍵...
FPGA（現(xiàn)場(chǎng)可編程門陣列）的基礎(chǔ)知識(shí)及其工作原理
高端設(shè)計(jì)工具為少有甚是沒(méi)有硬件設(shè)計(jì)技術(shù)的工程師和科學(xué)家提供現(xiàn)場(chǎng)可編程門陣列(FPGA)。無(wú)論你使用圖形化設(shè)計(jì)程序，ANSI C語(yǔ)言還是VHDL語(yǔ)言，如此復(fù)雜的合成工藝會(huì)不禁讓人去想FPGA真實(shí)的運(yùn)...
儀器驅(qū)動(dòng)的FPGA擴(kuò)展介紹與實(shí)例應(yīng)用
儀器驅(qū)動(dòng)的FPGA擴(kuò)展彌合了開(kāi)放式FPGA非并行靈活性和標(biāo)準(zhǔn)儀器驅(qū)動(dòng)兼容性之間的代溝。通過(guò)儀器驅(qū)動(dòng)的FPGA擴(kuò)展，您將能夠以非常簡(jiǎn)便的方法同時(shí)實(shí)現(xiàn)這兩個(gè)方面，使更多測(cè)試工程師可以利用FP...
2017-11-18 標(biāo)簽：FPGA 1491
Zynq-7000可完全編程SoC設(shè)備詳細(xì)介紹
十多年來(lái)，NI和Xilinx公司之間的技術(shù)合作不斷為工程師和科學(xué)家提供了進(jìn)行創(chuàng)新和改變世界的工具。 NI為其一代又一代的新產(chǎn)品(如NI FlexRIO模塊、CompactRIO控制器)提供最新一代的Xilinx FPGA。此外，...
可配置FFT IP核的實(shí)現(xiàn)及基礎(chǔ)教程
針對(duì)FFT算法基于FPGA實(shí)現(xiàn)可配置的IP核。采用基于流水線結(jié)構(gòu)和快速并行算法實(shí)現(xiàn)了蝶形運(yùn)算和4k點(diǎn)FFT的輸入點(diǎn)數(shù)、數(shù)據(jù)位寬、分解基自由配置。使用Verilog語(yǔ)言編寫，利用ModelSim仿真，由ISE綜合并...
基于FPCA可編程邏輯技術(shù)的時(shí)鐘恢復(fù)技術(shù)與系統(tǒng)同步詳解及應(yīng)用
隨著石油勘探的發(fā)展，在地震勘探儀器中越來(lái)越需要高精度的同步技術(shù)來(lái)支持高效采集。基于這種目的，采用FPGA技術(shù)設(shè)計(jì)了一種時(shí)鐘恢復(fù)以及系統(tǒng)同步方案，并完成了系統(tǒng)的固件和嵌入式軟件...
2017-11-18 標(biāo)簽：FPGAPCB設(shè)計(jì)時(shí)鐘可制造性設(shè)計(jì)華秋DFM 2150
Xilinx 7系列設(shè)備和NI cRIO-9068控制器創(chuàng)新詳解
Robert Bielby—Xilinx公司策略市場(chǎng)和業(yè)務(wù)規(guī)劃高級(jí)總監(jiān) 新的NI cRIO-9068可重配置機(jī)箱和NI PXIe-7975R NI FlexRIO FPGA模塊采用的是Xilinx 7系列完全可編程FPGA和SoC設(shè)備。如果要深入理解NI新的可重配置I/ O(RIO...
FPGA中主控VI等待和確認(rèn)信號(hào)終端與等待和確認(rèn)多個(gè)中斷步驟教程
某些FPGA終端允許通過(guò)FPGA VI生成中斷以通知主控VI事件。例如，數(shù)據(jù)已準(zhǔn)備好、產(chǎn)生錯(cuò)誤或任務(wù)完成。如要判定終端是否支持中斷，請(qǐng)?jiān)L問(wèn)FPGA終端屬性對(duì)話框的常規(guī)頁(yè)面的終端信息部分。 等待和...
采用流水線進(jìn)行FPGA VI吞吐量?jī)?yōu)化設(shè)計(jì)
流水線是一種可用于增強(qiáng)FPGA VI吞吐量的技術(shù)。在流水線設(shè)計(jì)中，用戶可利用FPGA的并行處理功能提高順序代碼的有效性。如要實(shí)現(xiàn)流水線，必須將代碼拆分為不同的級(jí)并連線每級(jí)的輸入和輸出端...
底層FPGA實(shí)現(xiàn)的簡(jiǎn)要概述
每個(gè)FPGA芯片(FPGA)是由有限個(gè)帶有可編程連接預(yù)定義資源組成。這些互連資源通過(guò)LabVIEW FPGA模塊實(shí)現(xiàn)用戶設(shè)計(jì)的數(shù)字電路。用戶創(chuàng)建FPGA VI時(shí)設(shè)計(jì)一個(gè)電路示意圖，以說(shuō)明FPGA邏輯塊的連接方式。編...
集成Xilinx內(nèi)核生成器IP至FPGA VI詳細(xì)步驟
LabVIEW使用IP集成節(jié)點(diǎn)方便的整合Xilinx內(nèi)核生成IP至FPGA VI。按照下列步驟添加X(jué)ilinx內(nèi)核生成器IP至FPGA VI。 1、在支持的FPGA終端下新建一個(gè)空白VI，并顯示VI的程序框圖。 2、右鍵單擊程序框圖顯示函...
FPGA VI中不同的Xilinx內(nèi)核生成器IP設(shè)計(jì)實(shí)現(xiàn)與子模板說(shuō)明
所屬選板：FPGA模塊VI和函數(shù) 必需：FPGA模塊。本主題的內(nèi)容可能與您所安裝的LabVIEW選板不匹配，LabVIEW選板上顯示的對(duì)象取決于操作系統(tǒng)、已獲得許可證的產(chǎn)品以及終端。 使用Xilinx內(nèi)核生成器...
基于FPGA的振動(dòng)信號(hào)采集處理系統(tǒng)設(shè)計(jì)并實(shí)際驗(yàn)證
在振動(dòng)信號(hào)采集和處理系統(tǒng)設(shè)計(jì)中，信號(hào)的處理時(shí)間與可靠性決定著系統(tǒng)應(yīng)用的可行性。本文設(shè)計(jì)了一種基于FPGA的振動(dòng)信號(hào)采集處理系統(tǒng)，該系統(tǒng)通過(guò)振動(dòng)信號(hào)采集電路、抗混疊濾波電路、A...
在FPGA平臺(tái)下實(shí)現(xiàn)基于平方倍頻法的BPSK調(diào)制信號(hào)載頻估計(jì)單元設(shè)計(jì)
根據(jù)BPSK調(diào)制信號(hào)調(diào)制機(jī)理和平方倍頻法原理，在FPGA平臺(tái)上設(shè)計(jì)實(shí)現(xiàn)了BPSK調(diào)制信號(hào)載波頻率估計(jì)單元。利用ModelSim仿真環(huán)境對(duì)載頻估計(jì)功能進(jìn)行仿真，驗(yàn)證了平方倍頻法對(duì)BPSK信號(hào)進(jìn)行載波信號(hào)估...
基于FPGA的LVDS過(guò)采樣技術(shù)研究并用Xilinx評(píng)估板進(jìn)行驗(yàn)證
針對(duì)LVDS接口，研究并實(shí)現(xiàn)了一種基于FPGA的LVDS過(guò)采樣技術(shù)，重點(diǎn)對(duì)LVDS過(guò)采樣技術(shù)中系統(tǒng)組成、ISERDESE2、時(shí)鐘采樣、數(shù)據(jù)恢復(fù)單元、時(shí)鐘同步狀態(tài)機(jī)等關(guān)鍵技術(shù)進(jìn)行了描述，并基于Xilinx FPGA進(jìn)行了...
2017-11-18 標(biāo)簽：FPGAlvds評(píng)估板FPGAlvds評(píng)估板過(guò)采樣 8450
Zynq-7000系列特征概述
相比較經(jīng)典的FPGA，Zynq-7000系列最大的特點(diǎn)是將處理系統(tǒng)PS和可編程資源PL分離開(kāi)來(lái)，固化了PS系統(tǒng)的存在，實(shí)現(xiàn)了真正意義上的SOC（System On Chip）。 1. Zynq-7000系列特征概述 Zynq-7000系列是全可編程...
基于FPGA的抖動(dòng)及消抖的方法
抖動(dòng)的產(chǎn)生,通常的按鍵所用開(kāi)關(guān)為機(jī)械彈性開(kāi)關(guān),當(dāng)機(jī)械觸點(diǎn)斷開(kāi)、閉合時(shí)，由于機(jī)械觸點(diǎn)的彈性作用，一個(gè)按鍵開(kāi)關(guān)在閉合時(shí)不會(huì)馬上穩(wěn)定地接通，在斷開(kāi)時(shí)也不會(huì)一下子斷開(kāi)。因而在閉合及...
2017-11-18 標(biāo)簽：FPGA 11057
NI系統(tǒng)級(jí)模塊（SOM）采用可重配置的FPGA技術(shù)
基于Zynq SoC,NI SOM經(jīng)過(guò)廣泛的測(cè)試與驗(yàn)證，并配有完整的軟件協(xié)議棧。 嵌入式設(shè)計(jì)團(tuán)隊(duì)肩負(fù)著處理眾多棘手問(wèn)題的重?fù)?dān)。他們需要跟上最新技術(shù)并提供眾多新功能以保持競(jìng)爭(zhēng)優(yōu)勢(shì)；同時(shí)，對(duì)于每...
基于FPGA時(shí)序優(yōu)化設(shè)計(jì)
現(xiàn)有的工具和技術(shù)可幫助您有效地實(shí)現(xiàn)時(shí)序性能目標(biāo)。當(dāng)您的FPGA 設(shè)計(jì)無(wú)法滿足時(shí)序性能目標(biāo)時(shí)，其原因可能并不明顯。解決方案不僅取決于FPGA 實(shí)現(xiàn)工具為滿足時(shí)序要求而優(yōu)化設(shè)計(jì)的能力，還...
xilinx Vivado HLS工作方式的優(yōu)勢(shì)與案例
不同層面的協(xié)議處理常見(jiàn)于各種新型通信系統(tǒng)，因?yàn)槿魏涡畔⒔涣鞫夹枰褂媚撤N通信協(xié)議。通信協(xié)議一般包含數(shù)據(jù)包。數(shù)據(jù)包由發(fā)送方創(chuàng)建，由接收方重新組合，這些操作都要遵循協(xié)議規(guī)范...
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