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電子發(fā)燒友網(wǎng)>可編程邏輯>

可編程邏輯

提供權(quán)威的PLD及可編程邏輯器件設計應用、Altera公司、Xilinx公司資訊和解決方案,包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。

限制原型驗證系統(tǒng)中FPGA數(shù)量的因素

當SoC系統(tǒng)的規(guī)模很大的時候,單片F(xiàn)PGA驗證平臺已經(jīng)無法容納這么多容量,我們將采取將SoC設計劃分為多個FPGA的映射。...

2023-04-06 標簽:FPGA設計TDMSoC系統(tǒng)時鐘信號 1587

FPGA設計的五個主要任務

FPGA設計的五個主要任務:邏輯綜合、門級映射、整體功能邏輯布局、邏輯資源互連布線,最后生成FPGA的bit流...

2023-04-06 標簽:FPGA設計EDA工具SoC芯片RTL 1678

同步復位信號如何跨時鐘域

XPM_CDC_SYNC_RST的Verilog代碼如下圖所示。代碼第16行參數(shù)DEST_SYNC_FF取值范圍為2~10的整數(shù),定義了級聯(lián)寄存器的個數(shù)。...

2023-04-06 標簽:FPGA觸發(fā)器復位信號 3287

基于FPGA實現(xiàn)分離用軟件的圖像處理系統(tǒng)設計

灰度直方圖統(tǒng)計直方圖是圖像的灰度分布統(tǒng)計的一種表示方法,統(tǒng)計目標圖像中各個灰度點的像素個數(shù),很多對于圖像的調(diào)整算法都是基于此進行的;如何基于FPGA進行統(tǒng)計呢?1)由于是統(tǒng)計圖...

2023-04-04 標簽:dspFPGAcpu圖像處理圖像分割 2137

如何使用Verilog HDL進行FPGA設計

FPGA設計流程是利用EDA開發(fā)軟件和編程工具對FPGA芯片進行開發(fā)的過程。FPGA的設計流程如上圖所示:包括設計定義、代碼實現(xiàn)、功能仿真、邏輯綜合、前仿真、布局布線、后仿真和板級調(diào)試等步驟...

2023-04-04 標簽:FPGApcbVerilog編輯器 3211

以DPU為中心的數(shù)據(jù)中心網(wǎng)絡架構(gòu)分析

DPU SoC的產(chǎn)品是前者迭代的終極形態(tài),需具備超高的異構(gòu)芯片技術(shù),通用可編程等特性,連同先進的芯片工藝,才能夠滿足更復雜、更廣泛、更高性能的應用需求。...

2023-04-04 標簽:FPGAcpu云計算DPU 1639

FPGA原型平臺到底能跑多快呢?

FPGA原型平臺的性能估計與應用過程的資源利用率以及FPGA性能參數(shù)密切相關(guān),甚至FPGA的制程也是一個因素。...

2023-04-04 標簽:寄存器RAMRTLSSIFPGA芯片 3450

基于Arm Cortex-M0處理器的智能娛樂收音機系統(tǒng)設計

本系統(tǒng)的主要功能部件包括ARM Cortex-M0內(nèi)核、AHB總線矩陣、CMSIS-DAP調(diào)試端口、語音識別模塊、SD卡模塊等,具體系統(tǒng)框圖如下圖所示。...

2023-04-03 標簽:FPGA射頻收音機無線通信 2511

PYNQ經(jīng)典項目分享:可重配置IO

上圖為工程項目示意圖。通過軟硬件劃分,在PS端中負責Linux和通信,PL端例化了6個PR(Partitial Reconfiguration)塊。每個塊中有GPIO、uart和IIC等幾種不同的RM(Reconfiguration Module)...

2023-04-03 標簽:FPGAAPIAPIFPGAPYNQ 1976

淺談PCI Express相關(guān)組件的集合

分離的DMA接口/ DMA客戶端模塊支持高度靈活,高性能的DMA操作。DMA接口和DMA客戶端模塊通過具有高性能分段存儲器接口的雙端口RAM連接。...

2023-04-03 標簽:存儲器XilinxPCIeAXI 1312

FPGA有哪些優(yōu)質(zhì)的帶源碼的IP開源網(wǎng)站?

Opencores是一個開源的數(shù)字電路設計社區(qū),它提供了免費的開源IP(知識產(chǎn)權(quán))核心,讓工程師和愛好者們可以使用這些IP核心來構(gòu)建自己的數(shù)字電路設計。Opencores的IP核心包括處理器、總線接口、...

2023-04-03 標簽:FPGAVerilogHDL 3377

幾方面簡單說明一下:EDA、IP、編譯速速、生態(tài)

尤其是在使用邏輯分析儀時候,會重新生成新的二進制文件(新的文件名),而上圖的文件位置并不會更新成新的文件,需要重新選擇,這兩點很容易讓你下載到FPGA的目標文件和生成的文件并...

2023-04-03 標簽:FPGA寄存器eda 2195

基于FPGA板卡的EDA、IP、編譯速速、生態(tài)介紹

高云的FPGA還有一個好處就是無需外部FLASH就可以固化啟動文件,因為FPGA內(nèi)部有FLASH(類似Intel CPLD),也可以使用外部FLASH進行雙備份,這樣即減少了電路復雜度,也減少了成本增加了穩(wěn)定性。...

2023-04-03 標簽:FPGA圖像處理eda邏輯分析儀 1393

LVDS高速ADC接口, xilinx FPGA實現(xiàn)

使用的AD芯片是ADI的AD9653,125M16bit高精度高速ADC,用到的采樣速率是80M。其SPI配置會單獨開一篇來講,SPI配置里面有個大坑,本來以為調(diào)好了的,后來又發(fā)現(xiàn)了問題,調(diào)了三天才定位到問題在哪...

2023-04-03 標簽:FPGAlvdsAD芯片 8876

如何建立適合團隊的FPGA原型驗證系統(tǒng)平臺與技術(shù)?

FPGA原型驗證在數(shù)字SoC系統(tǒng)項目當中已經(jīng)非常普遍且非常重要,但對于一個SoC的項目而言,選擇合適的FPGA原型驗證系統(tǒng)顯的格外重要...

2023-04-03 標簽:FPGA設計存儲器RAMSoC系統(tǒng) 2296

如何在可編程邏輯中實現(xiàn)MCU內(nèi)核設計

有時,微控制器本身可以完全滿足設計的所有功能要求。對于大多數(shù)嵌入式系統(tǒng)設計,編程良好、高度集成的嵌入式處理器是工程師可用的最具成本效益、最節(jié)能、最快的解決方案。 當原始性...

2023-04-01 標簽:微控制器FPGAmcu可編程邏輯FPGAmcu可編程邏輯微內(nèi)核微控制器 2324

介紹一種采用光SerDes而非電SerDes的高速收發(fā)器

同時介紹一種采用光電集成技術(shù)的,即采用光SerDes而非電SerDes的高速收發(fā)器。...

2023-04-01 標簽:FPGA收發(fā)器解串器SERDES接口 4653

ASIC芯片分類及特點分析

在集成電路界ASIC被認為是一種為專門目的而設計的集成電路,是指應特定用戶要求和特定電子系統(tǒng)的需要而設計、制造的集成電路。ASIC的特點是面向特定用戶的需求,ASIC在批量生產(chǎn)時與通用集...

2023-03-31 標簽:集成電路asic電子系統(tǒng) 4220

在FPGA上實現(xiàn)一個模塊,求32個輸入中的最大值和次大值

從算法本身來看,找最大值和次大值的過程很簡單;通過兩次遍歷:第一次求最大值,第二次求次大值; 算法復雜度是O(2n)。FPGA顯然不可能在一個周期內(nèi)完成如此復雜的操作,一般需要流水設計...

2023-03-31 標簽:FPGA模塊寄存器機器學習 1899

Xilinx FPGA上的PMOD接口類型

Pmod接口分為HOST和和Peripheral兩種類型,分為6pin、8pin和12pin等幾類,詳見“Digilent Pmod interface Specification Revision:November 20, 2011”。...

2023-03-31 標簽:FPGA連接器XilinxFPGAPmodXilinx連接器 4371

FSK調(diào)制解調(diào)方法簡析

FSK通信系統(tǒng)主要由基帶數(shù)據(jù)生成模塊(pcm.v)、FSK調(diào)制模塊(fsk_mod.v) 、FSK解調(diào)模塊(fsk_demod.v)和鎖相環(huán)位同步模塊(BitSync.v)組成。...

2023-03-31 標簽:FPGA鎖相環(huán)數(shù)字信號處理FPGAFSK數(shù)字信號處理鎖相環(huán) 6599

FPGA應用的電源模塊的選擇案例

現(xiàn)場可編程門陣列 (FPGA) 是許多原型和中小批量產(chǎn)品的核心。FPGA 的主要優(yōu)勢是開發(fā)過程中的靈活性、簡單的升級路徑、更快的上市時間和相對較低的成本。一個關(guān)鍵的缺點是復雜性,F(xiàn)PGA 通...

2023-03-30 標簽:FPGA開關(guān)穩(wěn)壓器線性穩(wěn)壓器Altera電源模塊 3038

時序分析是FPGA設計中永恒的話題

時鐘的時序特性主要分為抖動(Jitter)、偏移(Skew)、占空比失真(Duty Cycle Distortion)3點。對于低速設計,基本不用考慮這些特征;對于高速設計,由于時鐘本身的原因造成的時序問題很普遍,因此必須...

2023-03-30 標簽:FPGA時鐘時序分析 1341

FPGA設計使用復位信號應遵循原則

FPGA設計中幾乎不可避免地會用到復位信號,無論是同步復位還是異步復位。我們需要清楚的是復位信號對時序收斂、資源利用率以及布線擁塞都有很大的影響。...

2023-03-30 標簽:FPGA觸發(fā)器復位信號 2010

基于FPGA的硬件引腳分配設計總結(jié)

一個GT Quad由四個GT車道組成。為PCIe IP選擇GT Quads時,Xilinx建議您在最靠近PCIe硬塊的地方使用GT Quad。雖然這不是必要時,它將改善設計的位置,路線和時間。...

2023-03-30 標簽:FPGAXilinxPCIe 1522

基于XILINX FPGA的硬件設計總結(jié)之PCIE硬件設計避坑

一個GT Quad由四個GT車道組成。為PCIe IP選擇GT Quads時,Xilinx建議您在最靠近PCIe硬塊的地方使用GT Quad。雖然這不是必要時,它將改善設計的位置,路線和時間。...

2023-03-30 標簽:FPGA封裝硬件設計 5192

SPI通信的四種方式 FPGA的SPI從機實現(xiàn)方案

SPI通信有四種方式,由CPOL(時鐘極性)、CPHA(時鐘相位)的4種組合決定的。CPOL決定總線空閑時,SCK是高電平還是低電平(CPOL=,0,無數(shù)據(jù)傳輸時,SCK=0;CPOL=1,無數(shù)據(jù)傳輸時,SCK=1)。...

2023-03-29 標簽:FPGASPI移位寄存器SPI總線狀態(tài)機 7135

DPSK調(diào)制解調(diào)方案

基帶信號生成模塊(pcm.v)產(chǎn)生碼率為390.625kbps的基帶數(shù)據(jù),送給Coder.v完成相對碼的轉(zhuǎn)換,同時將絕對碼送CXD301擴展口觀測。轉(zhuǎn)換后的相對碼送給PSK調(diào)制模塊;...

2023-03-29 標簽:FPGA示波器數(shù)字信號處理bncDPSKFPGA數(shù)字信號處理示波器 5121

FPGA技術(shù):SerDes是怎么設計的

利用源同步接口,數(shù)據(jù)的有效窗口可以提高很多。通常頻率都在1GHz以下。在實際應用中可以見到如SPI4.2接口的時鐘可以高達DDR 700MHz x 16bits位寬。DDR Memory接口也算一種源同步接口,如DDR3在FPGA中...

2023-03-28 標簽:FPGA接口adcSerDes時鐘信號 3696

SoC的功能有多少可以通過FPGA原型驗證平臺來驗證?

我們當然希望在項目中盡快準備好基于FPGA原型驗證的代碼,以便最大限度地為軟件團隊和RTL驗證人員帶來更客觀的收益。...

2023-03-28 標簽:FPGAasicsocRTL 1920

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