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fpga設(shè)計(jì)

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

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fpga設(shè)計(jì)技術(shù)

詳解從均值濾波到非局部均值濾波算法的原理及實(shí)現(xiàn)方式

圖像降噪處理主要分為2D（空域）與3D降噪（時(shí)域/多幀），而2D降噪由于相關(guān)的實(shí)現(xiàn)算法豐富，效果各異，初學(xué)入門(mén)有著豐富的研究?jī)r(jià)值。

2023-07-03 標(biāo)簽：濾波器 FPGA設(shè)計(jì)比較器 3k 0

EDA程序設(shè)計(jì)—出租車(chē)計(jì)費(fèi)器

用EDA實(shí)訓(xùn)儀的I/O設(shè)備和FPGA實(shí)現(xiàn)出租車(chē)計(jì)費(fèi)器的設(shè)計(jì)。

2023-08-25 標(biāo)簽：FPGA設(shè)計(jì)led數(shù)碼管分頻器 3k 0

異步復(fù)位異步釋放會(huì)有什么問(wèn)題？FPGA異步復(fù)位為什么要同步釋放呢？

一般來(lái)說(shuō)，復(fù)位信號(hào)有效后會(huì)保持比較長(zhǎng)一段時(shí)間，確保 register 被復(fù)位完成。但是復(fù)位信號(hào)釋放時(shí)，因?yàn)槠浜蜁r(shí)鐘是異步的關(guān)系，我們不知道它會(huì)在什么時(shí)刻被釋放。

2024-01-24 標(biāo)簽：FPGA設(shè)計(jì)狀態(tài)機(jī)FDR 3k 0

請(qǐng)問(wèn)一下怎樣去使用HLS創(chuàng)建IP呢

每次我們更改硬件時(shí)，我們都需要告訴 HLS 將其導(dǎo)出為硬件描述語(yǔ)言并生成 Vivado 需要的所有各種源數(shù)據(jù)。

2022-09-22 標(biāo)簽：FPGA設(shè)計(jì)Vivado HLS 3k 0

FPGA速度-面積互換原則設(shè)計(jì)

速度-面積互換原則是貫穿FPGA設(shè)計(jì)的重要原則：速度是指工程穩(wěn)定運(yùn)行所能達(dá)到的最高時(shí)鐘頻率，通常決定了FPGA內(nèi)部寄存器的運(yùn)行時(shí)序；面積是指工程運(yùn)行所消...

2023-06-09 標(biāo)簽：fpga FPGA設(shè)計(jì)寄存器 3k 0

Vivado中設(shè)計(jì)鎖定與增量編譯方法簡(jiǎn)析

增量實(shí)現(xiàn)由兩個(gè)流程構(gòu)成：原始流程和增量流程，如圖所示。其中，原始流程提供網(wǎng)表。

2022-10-10 標(biāo)簽：FPGA設(shè)計(jì)RAM DCP 3k 0

FPGA設(shè)計(jì)心得之Aurora IP核例子簡(jiǎn)析與仿真

FLow Control 暫時(shí)選擇為None。（有必要后面專(zhuān)門(mén)研究，暫時(shí)最主要的還是弄懂用戶(hù)接口信號(hào)的用法?。?/p>

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)移位寄存器狀態(tài)機(jī) 3k 0

握手機(jī)制、通道依賴(lài)性及AXI-Lite握手實(shí)例

AXI4：高性能內(nèi)存映射需求（如讀寫(xiě)DDR、使用BRAM控制器讀寫(xiě)B(tài)RAM等），為了區(qū)別，有時(shí)候也叫這個(gè)為 AXI4-Full；

2023-06-25 標(biāo)簽：FPGA設(shè)計(jì)接收機(jī)BRAM 2.9k 0

FPGA在線調(diào)試的方法簡(jiǎn)單總結(jié)

Xilinx被AMD收購(gòu)的事情把我震出來(lái)了，看了看上上一篇文章講了下仿真的文件操作，這篇隔了很久遠(yuǎn)，不知道該從何講起，就說(shuō)說(shuō)FPGA的在線調(diào)試的一些簡(jiǎn)單...

2023-06-19 標(biāo)簽：FPGA設(shè)計(jì)RTL AXI總線 2.9k 0

【Soc級(jí)系統(tǒng)防御】Soc硬件木馬與電子鏈學(xué)習(xí)

隨著尖端工藝的代工成本和現(xiàn)代片上系統(tǒng)（system-on-a-chip，SoC）平臺(tái)設(shè)計(jì)復(fù)雜性的不斷提高，曾經(jīng)局限于一個(gè)國(guó)家甚至一家公司的IC供應(yīng)鏈已經(jīng)...

2023-11-20 標(biāo)簽：處理器 FPGA設(shè)計(jì)場(chǎng)效應(yīng)晶體管 2.9k 0

介紹一種ISE聯(lián)合仿真轉(zhuǎn)換為Moldelsim單獨(dú)仿真的方法

找到仿真頂層的tb文件，cut_through_top_tb。

2023-01-29 標(biāo)簽：FPGA設(shè)計(jì)asic ModelSim 2.8k 0

利用硬件輔助工具加速芯片前端設(shè)計(jì)的功能性驗(yàn)證階段

軟件仿真(Simulation)，F(xiàn)PGA原型驗(yàn)證(FPGA Based Prototyping)和硬件仿真加速(Emulation)這三種有效的功能驗(yàn)...

2022-10-10 標(biāo)簽：FPGA設(shè)計(jì)RTL AHB總線 2.8k 0

從處理單bit跨時(shí)鐘域信號(hào)同步問(wèn)題來(lái)入手

在數(shù)字電路中，跨時(shí)鐘域處理是個(gè)很龐大的問(wèn)題，因此將會(huì)作為一個(gè)專(zhuān)題來(lái)陸續(xù)分享。今天先來(lái)從處理單bit跨時(shí)鐘域信號(hào)同步問(wèn)題來(lái)入手。

2023-06-27 標(biāo)簽：FPGA設(shè)計(jì)IC設(shè)計(jì)仿真器 2.8k 0

采用FPGA設(shè)計(jì)科學(xué)級(jí)CCD相機(jī)時(shí)序發(fā)生器

科學(xué)級(jí)CCD相機(jī)一般由高速CCD感光芯片、視頻信號(hào)處理器、時(shí)序控制器、時(shí)序發(fā)生器、時(shí)序驅(qū)動(dòng)器、外部光學(xué)成像系統(tǒng)等部分組成，本文分析了IL-E2型TDI-...

2017-11-24 標(biāo)簽：fpga ccd FPGA設(shè)計(jì) 2.8k 0

基于賽靈思Kintex-7 FPGA設(shè)計(jì)或硬件原型的快速部署方法

PLDA集團(tuán)的990美元XpressK7 PCIe板卡，為系統(tǒng)設(shè)計(jì)師提供了一個(gè)基于賽靈思Kintex-7 FPGA設(shè)計(jì)或硬件原型的快速部署方法。這個(gè)主板...

2017-02-10 標(biāo)簽：FPGA FPGA設(shè)計(jì)賽靈思 2.8k 0

ASIC和FPGA到底選哪個(gè)好？?jī)烧叩牧鞒逃惺裁磪^(qū)別？

ASIC (Application Specific Integrated Circuit)，即專(zhuān)用集成電路，是指應(yīng)特定用戶(hù)要求和特定電子系統(tǒng)的需要而設(shè)...

2023-09-02 標(biāo)簽：FPGA設(shè)計(jì)存儲(chǔ)器 ASIC芯片 2.7k 0

如何在FPGA上快速搭建以太網(wǎng)？

LWIP 是使用裸機(jī)設(shè)計(jì)以太網(wǎng)的良好起點(diǎn)，在此基礎(chǔ)上我們可以輕松調(diào)整軟件應(yīng)用程序以提供更詳細(xì)的應(yīng)用程序。LWIP Echo 服務(wù)器的使用首先使我們能夠確...

2023-09-08 標(biāo)簽：fpga FPGA設(shè)計(jì)以太網(wǎng) 2.7k 0

fpga設(shè)計(jì)流程包含哪幾個(gè)部分

FPGA是一種可編程芯片，因此FPGA的設(shè)計(jì)方法包括硬件設(shè)計(jì)和軟件設(shè)計(jì)兩部分。硬件包括FPGA芯片電路、存儲(chǔ)器、輸入輸出接口電路等器件。軟件是對(duì)應(yīng)的VH...

2023-07-03 標(biāo)簽：fpga FPGA設(shè)計(jì)可編程芯片 2.7k 0

芯片設(shè)計(jì)流程概要

芯片設(shè)計(jì)過(guò)程是一項(xiàng)復(fù)雜的多步驟工作，涉及從初始系統(tǒng)規(guī)格到制造的各個(gè)階段。

2023-06-05 標(biāo)簽：處理器 FPGA設(shè)計(jì)RISC 2.7k 0

FPGA設(shè)計(jì)的IP和算法應(yīng)用綜述

IP(Intelligent Property) 核是具有知識(shí)產(chǎn)權(quán)核的集成電路芯核總稱(chēng)，是經(jīng)過(guò)反復(fù)驗(yàn)證過(guò)的、具有特定功能的宏模塊，與芯片制造工藝無(wú)關(guān)，可...

2024-03-07 標(biāo)簽：FPGA設(shè)計(jì)寄存器 EDA工具 2.7k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

VHDL代碼

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powerlink

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Protel 99 se

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面包板

面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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