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fpga

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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。

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fpga技術(shù)

FPGA所能應(yīng)用的領(lǐng)域的六大類

在數(shù)字信號(hào)處理領(lǐng)域 FPGA 同樣所向披靡,主要是因?yàn)樗母咚俨⑿刑幚砟芰?。FPGA最大優(yōu)勢(shì)是其并行處理機(jī)制,即利用并行架構(gòu)實(shí)現(xiàn)數(shù)字信號(hào)處理的功能。

2022-08-31 標(biāo)簽:fpga數(shù)字信號(hào)處理通信系統(tǒng) 1.1k 0

FPGA太強(qiáng)了,就是有點(diǎn)小貴!

FPGA太強(qiáng)了,就是有點(diǎn)小貴!

很多粉絲問(wèn)我,嵌入式方向中的FPGA怎么樣?收入如何? 前言 講述FPGA前,我們先講講當(dāng)年中興被制裁的問(wèn)題。 美國(guó)前總統(tǒng)特朗普曾經(jīng)發(fā)布過(guò)一條禁令,由于...

2022-08-31 標(biāo)簽:fpga 3.1k 0

無(wú)線信號(hào)的干擾技術(shù)和抗干擾措施

無(wú)線信號(hào)的干擾技術(shù)和抗干擾措施

加密也將在這里發(fā)揮作用。任何可以減緩智能干擾器或防止數(shù)據(jù)攔截的方法都是一件好事。同樣,基于硬件的實(shí)時(shí)加密和解密技術(shù)比單獨(dú)的軟件加密執(zhí)行得更好。

2022-08-30 標(biāo)簽:fpgagps無(wú)線通信 9.5k 0

基于FPGA搭建ARM Cortex-M3 SoC軟核

上一篇文章介紹了ARM DesignStart計(jì)劃,其中提到了Cortex-M1/M3 DesignStart FPGA版本,支持Xilinx和國(guó)產(chǎn)Go...

2022-08-30 標(biāo)簽:fpgaarmsoc 4.8k 0

基于TL6678F-EasyEVM開(kāi)發(fā)板的高速AD采集處理案例

本文基于創(chuàng)龍科技的TI C6678 + Xilinx Kintex-7設(shè)計(jì)的TL6678F-EasyEVM開(kāi)發(fā)板,給大家介紹高速AD采集處理案例,包含C...

2022-08-29 標(biāo)簽:dspfpga開(kāi)發(fā)板 1.6k 0

Xilinx 7系列FPGA PCB仿真和分析

大多數(shù)差分躍遷都是通過(guò)電容。P和N路徑相互耦合,增加了電容。許多躍遷在寬頻帶上具有與集總電容相同的頻率響應(yīng)。通過(guò)設(shè)計(jì),增加電感可以抵消這種過(guò)剩。

2022-08-29 標(biāo)簽:fpgapcbXilinx 2k 0

FPGA學(xué)習(xí)-總結(jié)fifo設(shè)計(jì)中深度H的計(jì)算

對(duì)于fifo來(lái)說(shuō),H的設(shè)置至關(guān)重要。既要保證功能性,不溢出丟數(shù),也要保證性能流水。深度設(shè)置過(guò)小會(huì)影響功能,過(guò)大又浪費(fèi)資源。因此,總結(jié)下fifo設(shè)計(jì)中深度...

2022-08-29 標(biāo)簽:fpgafifo 2.1k 0

將OpenCL編譯到FPGA

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OpenCL 框架解決異構(gòu)計(jì)算的挑戰(zhàn)

2022-08-29 標(biāo)簽:fpgacpuOpenCL 3.8k 0

FPGA學(xué)習(xí)之CRC校驗(yàn)

其中有的CRC寄存器初始值設(shè)置為全1,如以太網(wǎng)的CRC32,目的就是為了能檢測(cè)出數(shù)據(jù)前面的0的個(gè)數(shù)。1234算出來(lái)的CRC,跟01234算出來(lái)的,不一樣...

2022-08-26 標(biāo)簽:fpga寄存器crc 4.2k 0

使用FPGA開(kāi)發(fā)視頻算法進(jìn)行圖像和實(shí)時(shí)視頻處理

使用FPGA開(kāi)發(fā)視頻算法進(jìn)行圖像和實(shí)時(shí)視頻處理

硬件調(diào)整大小和去隔行簡(jiǎn)化了視頻數(shù)據(jù)的格式化和索引,以允許更多的編碼資源用于圖像數(shù)據(jù)處理和覆蓋到顯示數(shù)據(jù)上。這種疊加的示例包括調(diào)整大小的圖像,這些圖像可以...

2022-08-25 標(biāo)簽:處理器fpga圖像處理 2.2k 0

FPGA內(nèi)部邏輯結(jié)構(gòu)實(shí)現(xiàn)的基礎(chǔ)

只有在腦海中建立了一個(gè)個(gè)邏輯模型,理解FPGA內(nèi)部邏輯結(jié)構(gòu)實(shí)現(xiàn)的基礎(chǔ),才能明白為什么寫Verilog和寫C整體思路是不一樣的,才能理解順序執(zhí)行語(yǔ)言和并行...

2022-08-25 標(biāo)簽:fpga接口時(shí)序電路 1.4k 0

基于FPGA 架構(gòu)的微控制器子系統(tǒng)實(shí)現(xiàn)

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該入門套件包含一個(gè)系統(tǒng)級(jí)模塊 (SOM),其中包含帶有相關(guān)存儲(chǔ)器和時(shí)鐘的 Microsemi SmartFusion2 FPGA SoC 器件,以及一個(gè)...

2022-08-25 標(biāo)簽:微控制器fpga電源轉(zhuǎn)換器 836 0

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自從商業(yè)上可行的 FPGA 出現(xiàn)以來(lái),嵌入式設(shè)計(jì)人員就已經(jīng)實(shí)現(xiàn)了異構(gòu)架構(gòu)。最初,F(xiàn)PGA 主要用作處理系統(tǒng)、外設(shè)和 I/O 之間接口的粘合邏輯。但隨著 ...

2022-08-25 標(biāo)簽:fpgamcusoc 1.6k 0

FPGA電路中的毛刺現(xiàn)象

和所有的數(shù)字電路一樣,毛刺也是FPGA電路中的棘手問(wèn)題,它的出現(xiàn)會(huì)影響電路工作的穩(wěn)定性,可靠性,嚴(yán)重時(shí)會(huì)導(dǎo)致整個(gè)數(shù)字系統(tǒng)的誤動(dòng)作和邏輯紊亂。

2022-08-25 標(biāo)簽:fpga電容數(shù)字電路 2.5k 0

FPGA的組成、類型及應(yīng)用

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現(xiàn)場(chǎng)可編程門陣列 (FPGA) 是數(shù)字 IC(集成電路),使硬件設(shè)計(jì)工程師能夠根據(jù)他們的要求對(duì)定制的數(shù)字邏輯進(jìn)行編程。術(shù)語(yǔ)“現(xiàn)場(chǎng)可編程”意味著IC的數(shù)字...

2022-08-23 標(biāo)簽:fpga可編程門陣列可編程邏輯 6.6k 0

如何使用電源定序器來(lái)實(shí)現(xiàn)指定的電源軌定時(shí)及定序

如何使用電源定序器來(lái)實(shí)現(xiàn)指定的電源軌定時(shí)及定序

該定序技術(shù)最好使用定序器集成電路(如 Texas Instruments 的 LM3880)來(lái)實(shí)現(xiàn)。LM3880 是一款簡(jiǎn)單的電源定序器,可通過(guò)穩(wěn)壓器或...

2022-08-23 標(biāo)簽:fpga線性穩(wěn)壓器模數(shù)轉(zhuǎn)換器 2k 0

如何基于ARM在FPGA上搭建一個(gè)Cortex-M3軟核處理器

由于ARM程序是下載到Cortex-M3軟核內(nèi)的RAM存儲(chǔ)區(qū),所以掉電后程序會(huì)丟失。如何將程序下載到片外的SPI Flash中,我還沒(méi)有成功實(shí)現(xiàn)。

2022-08-22 標(biāo)簽:fpgaarmCortex-M3 4.3k 0

如何定制一顆ARM Cortex-M3 SoC軟核

本文將手把手教你如何基于ARM DesignStart計(jì)劃,在FPGA上搭建一個(gè)Cortex-M3軟核處理器。 以Xilinx Artix-7系列F...

2022-08-22 標(biāo)簽:處理器fpgaCortex-M3 4k 0

使用ISERDES接收高速串行數(shù)據(jù)

使用ISERDES接收高速串行數(shù)據(jù)

但是,在內(nèi)部處理信號(hào)時(shí),數(shù)據(jù)信號(hào)往往是多bit信號(hào),而傳輸過(guò)程中需要用到單bit串行傳輸技術(shù),所以,中間需要有一個(gè)轉(zhuǎn)換器,實(shí)現(xiàn)并串轉(zhuǎn)換,這就需要用到SE...

2022-08-20 標(biāo)簽:fpga轉(zhuǎn)換器DDR 6.8k 0

使用Idelay對(duì)接收端時(shí)序進(jìn)行補(bǔ)救

使用Idelay對(duì)接收端時(shí)序進(jìn)行補(bǔ)救

同樣,為了減小相同參考時(shí)鐘下Idelay2與IDELAYCTRL 的FPGA內(nèi)部走線延時(shí),必須使用IODELAY_GROUP將它們綁定在一起,使用方法參...

2022-08-20 標(biāo)簽:fpga串行通信高速信號(hào) 6.6k 0

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    靜電防護(hù)
    +關(guān)注
    為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞,以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生,加速靜電泄漏,進(jìn)行靜電中和等。
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