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EDA/IC設(shè)計
電子發(fā)燒友網(wǎng)本欄目為EDA/IC設(shè)計專區(qū)，有豐富的EDA/IC設(shè)計應(yīng)用知識與EDA/IC設(shè)計資料，可供EDA/IC行業(yè)人群學(xué)習(xí)與交流。
PCB印刷電路板的特性阻抗控制
近年來，IC集成度的提高和應(yīng)用，其信號傳輸頻率和速 度越來越高，因而在印制板導(dǎo)線中，信號傳輸（發(fā)射）高到 某一定值后，便會受到印制板導(dǎo)線本身的影響，從而導(dǎo)致傳 輸信號的嚴(yán)重失真...
PCB板的過孔會對信號傳輸造成什么影響
從設(shè)計角度來看，一個過孔主要由兩個部分組成，一是中間鉆孔（drill hole）,二是鉆孔周圍焊盤區(qū)。這兩部分尺寸大小決定了過孔大小。很顯然，在高速,高密度PCB設(shè)計時，設(shè)計者總是希望過孔越...
2019-06-19 標(biāo)簽：PCB板PCB設(shè)計過孔信號傳輸可制造性設(shè)計華秋DFM 6423
PCB電路抑制共阻抗干擾的措施有哪些
共阻干擾是由PCB上大量的地線造成。當(dāng)兩個或兩個以上的回路共用一段地線時，不同的回路電流在共用地線上產(chǎn)生一定壓降，此壓降經(jīng)放大就會影響電路性能;當(dāng)電流頻率很高時，會產(chǎn)生很大的...
PCB走線寬度變化對信號產(chǎn)生的影響分析
如果阻抗變化只發(fā)生一次，例如線寬從8mil變到6mil后，一直保持6mil寬度這種情況，要達(dá)到突變處信號反射噪聲不超過電壓擺幅的5%這一噪聲預(yù)算要求，阻抗變化必須小于10%。這有時很難做到，以...
PCB印制電路板的板面設(shè)計步驟和方法
印制電路板是電子產(chǎn)品中電路元件和器件的支撐件，它提供電路元件和器件之間的電氣連接。為提高印制板的抗振、抗沖擊性能，板 上的負(fù)荷應(yīng)合理分布以免產(chǎn)生過大的應(yīng)力。對 大而重的元件...
PCB電路板設(shè)計的七大實用步驟解析
電路原理圖的設(shè)計：電路原理圖的設(shè)計主要是PROTEL099的原理圖設(shè)計系統(tǒng)（AdvancedSchematic）來繪制一張電路原理圖。在這一過程中，要充分利用PROTEL99所提供的各種原理圖繪圖工具、各種編輯功能...
廢棄PCB板的回收處理方法解析
PCB表面一般涂有一層漆保護(hù)金屬，回收處理之前應(yīng)先脫除漆。脫漆劑有有機脫漆劑和堿性脫漆劑，有機脫漆劑毒性大，對人體和環(huán)境危害大，堿性脫漆劑毒性相對較小。我們通過實驗得到脫漆最...
2019-06-19 標(biāo)簽：PCB板 9993
PCB設(shè)計中如何消除或印制導(dǎo)線阻抗產(chǎn)生的干擾
PCB上的印制導(dǎo)線通電后在直流或交流狀態(tài)下分別對電流呈現(xiàn)電阻或感抗，而平行導(dǎo)線之間存在電感效應(yīng)，電阻效應(yīng)，電導(dǎo)效應(yīng)，互感效應(yīng)；一根導(dǎo)線上的變化電流必然影響另一根導(dǎo)線，從而產(chǎn)生...
2019-06-20 標(biāo)簽：印制電路板阻抗PCB設(shè)計 1516
基于信號完整性的PCB仿真設(shè)計與研究
高速數(shù)字電路設(shè)計方面的問題突出體現(xiàn)為以下類型：（1）工作頻率的提高和信號上升/下降時間的縮短，會使設(shè)計系統(tǒng)的時序裕量縮小甚至出現(xiàn)時序方面的問題；（2）傳輸線效應(yīng)導(dǎo)致的信號震蕩...
2019-06-20 標(biāo)簽：PCB設(shè)計信號完整性 1447
基于解決背板互連設(shè)計問題的兩種信號完整性解決方案
不斷部署的高帶寬業(yè)務(wù)逐漸逼近已有網(wǎng)絡(luò)和通信系統(tǒng)基礎(chǔ)設(shè)施的極限，推動了新系統(tǒng)的發(fā)展。在升級現(xiàn)有設(shè)備或設(shè)計新系統(tǒng)以獲得更高速鏈路時，背板互連的信號完整性是需要解決的一個基本問...
2019-06-20 標(biāo)簽：PCB設(shè)計信號完整性互連設(shè)計 1886
基于ASIC芯片設(shè)計中的信號完整性問題解決方案
隨著工藝技術(shù)的發(fā)展，導(dǎo)致信號串?dāng)_的機會增加了。金屬布線層數(shù)持續(xù)增加：從0.35um工藝的4層或者5層增加到0.13um工藝中的超過7層金屬布線層。隨著布線層數(shù)的增加，相鄰的溝道電容也會增加。...
2019-06-20 標(biāo)簽：PCB設(shè)計信號完整性ASIC芯片 2878
如何檢查PCB電路板的短路問題
如果是人工焊接，要養(yǎng)成好的習(xí)慣，首先，焊接前要目視檢查一遍PCB板，并用萬用表檢查關(guān)鍵電路（特別是電源與地）是否短路;其次，每次焊接完一個芯片就用萬用表測一下電源和地是否短路...
如何使用IBIS模型來確定PCB板的信號完整性問題
本文是關(guān)于在印刷電路板（PCB）開發(fā)階段使用數(shù)字輸入/輸出緩沖信息規(guī)范（IBIS）模擬模型的文章。本文將介紹如何使用一個IBIS模型來提取一些重要的變量，用于信號完整性計算和確定PCB設(shè)計解...
PCB板信號完整性的定義及解決方案
信號完整性（SignalIntegrity），是指信號未受到損傷的一種狀態(tài)。它表明信號通過信號線傳輸后仍保持其正確的功能特性，信號在電路中能以正確的時序和電壓作出響應(yīng)，由IC的時序可知，如果信...
如何使用SpecctraQuest工具對PCB電路板進(jìn)行損耗預(yù)測
本文所討論的工具包括：Allegro和SpecctraQuest、Hspice、Spicelink和HFSS：Allegro是目前通用的版圖設(shè)計工具；由于具備與Allegro相同的數(shù)據(jù)庫，SpecctraQuest被用做板級仿真的主要工具，避免了數(shù)據(jù)轉(zhuǎn)換的問...
PCB電路板上把走線當(dāng)傳輸線的處理方法解析
信號在這條走線上向前傳播，傳輸?shù)阶呔€盡頭需要10ns，返回到源端又需要10ns，則總的往返時間是20ns。如果把上面的信號往返路徑看成普通的電流回路的話，返回路徑上應(yīng)該沒有電流，因為在遠(yuǎn)...
PCB電路板信號反射的處理方法
信號沿傳輸線向前傳播時，每時每刻都會感受到一個瞬態(tài)阻抗，這個阻抗可能是傳輸線本身的，也可能是中途或末端其他元件的。對于信號來說，它不會區(qū)分到底是什么，信號所感受到的只有阻...
PCB電路中信號振鈴是怎么產(chǎn)生的
信號振鈴的過程可以用反彈圖來直觀的解釋。假設(shè)驅(qū)動端的輸出阻抗是10歐姆，PCB走線的特性阻抗為50歐姆（可以通過改變PCB走線寬度，PCB走線和內(nèi)層參考平面間介質(zhì)厚度來調(diào)整），為了分析方...
PCB電路中信號終端電容的作用介紹
信號的接收端可能是集成芯片的一個引腳，也可能是其他元器件。不論接收端是什么，實際的器件的輸入端必然存在寄生電容，接受信號的芯片引腳和相鄰引腳之間有一定的寄生電容，和引腳相...
如何解決PCB高速系統(tǒng)的功率失配問題
信號布線在以前通常被看作是一種簡單的概念，從布線角度看，視頻信號、語音信號或數(shù)據(jù)信號之間沒有什么區(qū)別。因此過去很少有人關(guān)心信號布線問題。然而，現(xiàn)在情況有了完全的改變。視頻...
2019-06-24 標(biāo)簽：PCB設(shè)計 706
如何利用先進(jìn)的EDA工具進(jìn)行高速高密度的PCB設(shè)計
信號完整性技術(shù)經(jīng)過幾十年的發(fā)展，其理論和分析方法都已經(jīng)較為成熟。對于信號完整性問題，信號完整性不是某個人的問題，它涉及到設(shè)計鏈的每一個環(huán)節(jié)，不但系統(tǒng)設(shè)計工程師、硬件工程師...
2019-06-24 標(biāo)簽：EDA工具PCB設(shè)計信號完整性 1005
如何正確的對DDR3總線進(jìn)行信號完整性測試
針對嵌入式系統(tǒng)，建議在PCB設(shè)計過程中，做可測性設(shè)計，即規(guī)劃好準(zhǔn)備測試那些信號，然后留出測試點（包括測試點附近的接地點），測試點要盡量靠近DRAM IC管腳處，因為Jedec規(guī)范的位置是BG...
2019-06-24 標(biāo)簽：信號完整性 11666
PCB板上特性阻抗對信號完整性的作用介紹
如果PCB上線條的厚度增大或者寬度增加，單位長度電容增加，特性阻抗就變小。同樣，走線和返回平面間距離減小，電容增大，特性阻抗也減小。...
PCB板上設(shè)計商要求指定和控制DC跡線阻抗的原因分析
1. 由于電源電壓和相關(guān)的邏輯電路門限降低了- 1伏不是常見的電壓，但卻可以減少噪音。特別是處理器和大電流密度的設(shè)備會吸引幾安培的電源電流的情況下。 2. LVDS 和千兆位以太網(wǎng)都含有...
2019-06-24 標(biāo)簽：PCB板 1064
常用的三種PCB板級信號完整性分析模型介紹
在基于信號完整性計算機分析的PCB設(shè)計方法中，最為核心的部分就是pcb板級信號完整性模型的建立，這是與傳統(tǒng)的設(shè)計方法的區(qū)別之處。SI模型的正確性將決定設(shè)計的正確性，而SI模型的可建立...
高速DSP系統(tǒng)的信號完整性分析
信號完整性的問題主要包括傳輸線效應(yīng)，如反射、時延、振鈴、信號的過程與下沖以及信號之間的串?dāng)_等，涉及傳輸線上的信號質(zhì)量及信號定時的準(zhǔn)確性。 良好的信號質(zhì)量是確保穩(wěn)定時序的...
2019-06-24 標(biāo)簽：PCB板信號完整性DSP系統(tǒng) 1907
基于高速DSP電路的PCB抗干擾設(shè)計
信號完整性主要有反射、振鈴、地彈和串?dāng)_等現(xiàn)象。PCB板上的走線可等效為圖1所示的串聯(lián)和并聯(lián)的電容、電阻和電感結(jié)構(gòu)。串聯(lián)電阻的典型值0.25D.／R-4）。55DJft，并聯(lián)電阻阻值通常很高。將寄...
2019-06-25 標(biāo)簽：dspPCB設(shè)計抗干擾設(shè)計 1273
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