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正點原子開拓者FPGA開發(fā)板配套視頻:FPGA是什么

正點原子開拓者FPGA開發(fā)板配套視頻:FPGA是什么

正點原子開拓者FPGA開發(fā)板配套視頻...

類別:電子說 更新:2019-09-04 關鍵字: FPGA汽車電子

FPGA之硬件語法篇:Verilog關鍵問題解惑

FPGA之硬件語法篇:Verilog關鍵問題解惑

大家都知道軟件設計使用軟件編程語言,例如我們熟知的C、Java等等,而FPGA設計使用的是HDL語言,例如VHDL和Verilog HDL。說的直白點,F(xiàn)PGA的設計就是邏輯電路的實現(xiàn),就是把我們從數(shù)字電路中學...

類別:電子說 更新:2019-12-05 關鍵字: FPGAVerilog代碼

正點原子FPGA實戰(zhàn)篇:串口通信(3)

正點原子FPGA實戰(zhàn)篇:串口通信(3)

正點原子FPGA開發(fā)板配套視頻...

類別:電子說 更新:2019-09-04 關鍵字: FPGA計算機串口通信

正點原子開拓者FPGA視頻:OV5640 LCD顯示視頻

正點原子開拓者FPGA視頻:OV5640 LCD顯示視頻

OV5640 攝像頭主要由鏡頭、圖像傳感器、板載電路及下方的信號引腳組成。鏡頭部件包含一個鏡頭座和一個可旋轉(zhuǎn)調(diào)節(jié)距離的凸透鏡,通過旋轉(zhuǎn)可以調(diào)節(jié)焦距,正常使用時,鏡頭座覆蓋在電路板...

類別:電子說 更新:2019-09-23 關鍵字: lcd圖像傳感器攝像頭

FPGA之項目實戰(zhàn)篇:數(shù)碼管顯示設計

FPGA之項目實戰(zhàn)篇:數(shù)碼管顯示設計

我們例舉三人表決器、數(shù)字時鐘、多終端點歌系統(tǒng)、數(shù)字示波器這四個實際的工程項目,手把手帶領大家從分析工程、分解工程、到最終實現(xiàn)工程。通過逐個解決工程中的實際問題,來學習原汁...

類別:電子說 更新:2019-12-06 關鍵字: FPGA數(shù)碼管驅(qū)動電路

FPGA之項目實戰(zhàn)篇:LED外設進階

我們例舉三人表決器、數(shù)字時鐘、多終端點歌系統(tǒng)、數(shù)字示波器這四個實際的工程項目,手把手帶領大家從分析工程、分解工程、到最終實現(xiàn)工程。通過逐個解決工程中的實際問題,來學習原汁...

類別:電子說 更新:2019-12-06 關鍵字: FPGAled時鐘

正點原子FPGA實戰(zhàn)篇:VGA彩條顯示實驗(2)

正點原子FPGA實戰(zhàn)篇:VGA彩條顯示實驗(2)

正點原子FPGA開發(fā)板配套視頻...

類別:電子說 更新:2019-09-04 關鍵字: FPGA存儲VGA

正點原子FPGA:精度頻率計實驗

正點原子FPGA:精度頻率計實驗

正點原子FPGA開發(fā)板配套視頻...

類別:電子說 更新:2019-09-09 關鍵字: 示波器頻率計計數(shù)器

正點原子FPGA實戰(zhàn):錄音機實驗

正點原子FPGA實戰(zhàn):錄音機實驗

正點原子FPGA開發(fā)板配套視頻...

類別:電子說 更新:2019-09-05 關鍵字: FPGA機器錄音機

正點原子FPGA實戰(zhàn)篇:基于FFT-IP核的音頻頻譜儀實驗(2)

正點原子FPGA實戰(zhàn)篇:基于FFT-IP核的音頻頻譜儀實驗(2)

正點原子FPGA開發(fā)板配套視頻...

類別:電子說 更新:2019-09-05 關鍵字: FPGA頻譜儀

正點原子FPGA實戰(zhàn)篇:基于以太網(wǎng)的板對板音頻互傳實驗

正點原子FPGA實戰(zhàn)篇:基于以太網(wǎng)的板對板音頻互傳實驗

正點原子FPGA開發(fā)板配套視頻...

類別:電子說 更新:2019-09-05 關鍵字: FPGA以太網(wǎng)音頻

時序約束:不需要檢查的路徑

時序約束:不需要檢查的路徑

時序表示動態(tài)規(guī)?;蜻^程的時間演化。它們用于識別、建模和預測在離散時間間隔內(nèi)采樣的數(shù)據(jù)中的模式和行為??紤]使用時間表而不是 timeseries 對象,以便將時間戳數(shù)據(jù)存儲為列向數(shù)據(jù)變量。...

類別:電子說 更新:2019-12-20 關鍵字: 數(shù)據(jù)時序

正點原子FPGA實戰(zhàn)篇:音頻環(huán)回實驗

正點原子FPGA實戰(zhàn)篇:音頻環(huán)回實驗

正點原子FPGA開發(fā)板配套視頻...

類別:電子說 更新:2019-09-05 關鍵字: FPGA音頻設備

時序約束步驟:系統(tǒng)同步與源同步

時序約束步驟:系統(tǒng)同步與源同步

針對普通時鐘系統(tǒng)存在著限制時鐘頻率的弊端,人們設計了一種新的時序系統(tǒng),稱之為源同步時序系統(tǒng)。它最大的優(yōu)點就是大大提升了總線的速度,在理論上信號的傳送可以不受傳輸延遲的影響...

類別:電子說 更新:2019-12-20 關鍵字: 時鐘總線時序

FPGA Verilog實現(xiàn)4位數(shù)碼管動態(tài)顯示

FPGA Verilog實現(xiàn)4位數(shù)碼管動態(tài)顯示

Verilog HDL是一種硬件描述語言,以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構和行為的語言,用它可以表示邏輯電路圖、邏輯表達式,還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。...

類別:電子說 更新:2019-12-23 關鍵字: FPGAVerilog數(shù)碼管

FPGA的組成結(jié)構和優(yōu)缺點講解

這期視頻Dave Jones講解了FPGA的大致組成結(jié)構,列舉了它的優(yōu)點和缺點,最后給初學者提了一些簡單的建議。...

類別:電子說 更新:2019-08-29 關鍵字: FPGA電子設計

FPGA簡單入門和邏輯塊與相對于處理器的并行操作

4分鐘的FPGA簡單入門介紹,主要介紹了邏輯塊、相對于處理器的并行操作。搬運于YouTube,字幕自制。...

類別:電子說 更新:2019-08-29 關鍵字: 處理器FPGA邏輯

時序約束步驟:生成時鐘約束

時序約束步驟:生成時鐘約束

差分時鐘是將數(shù)據(jù)從源傳送到目的地有兩種常用的電氣方法。一種方法使用“單端”發(fā)信號概念,它在發(fā)射機和接收機之間使用兩個導體。...

類別:電子說 更新:2019-12-20 關鍵字: 數(shù)據(jù)時鐘時序

基于FPGA的軟核處理器設計實現(xiàn)

本課程從數(shù)字IC設計工程師應具備的基本技能講起。首先介紹數(shù)字芯片設計流程,主流EDA工具的使用,包括Design Compiler、Prime Time、Formality、VCS+verdi等。并介紹Verilog基本語法,使用verilog編寫簡單...

類別:電子說 更新:2019-08-29 關鍵字: 處理器FPGAcpu

基于STEP-MXO2-C核心板設計機器人競賽通用軟硬件平臺

本設計采用STEP-MXO2-C核心板為控制板,設計了一款適用于各類機器人比賽的通用軟硬件平臺,30路的舵機脈沖輸出,可用于雙足機器人的舵機控制板;10路以上的電機脈沖輸出,可用于智能車和四...

類別:電子說 更新:2019-12-23 關鍵字: 機器人電機WIFI
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