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FPGA/ASIC技術(shù)
電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識(shí)以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學(xué)習(xí)FPGA/ASIC技術(shù)的好欄目。
裸機(jī)AMP(非對稱多進(jìn)程處理模式)
在上一篇博客中，我們已經(jīng)將Zynq SoC啟動(dòng)并運(yùn)行起來，在AMP（非對稱多進(jìn)程處理）模式下使用了兩個(gè)ARM Cortex-A9 MPCore處理器，然而因?yàn)樯弦黄┛鸵呀?jīng)相當(dāng)長了，我沒有詳細(xì)的介紹軟件方面的工...
在Zynq SoC上實(shí)現(xiàn)雙核非對稱的多進(jìn)程處理模式
在我的上一篇博客中我介紹了利用Zynq SoC上的兩個(gè)ARM Cortex-A9 MPCore處理器執(zhí)行不同的任務(wù)程序，實(shí)現(xiàn)非對稱的多進(jìn)程處理模式的概念。...
利用32.75Gbps Virtex UItraScale GTY收發(fā)器做些什么？
賽靈思Virtex UltraScale架構(gòu)全可編程器件的很多特色中的一個(gè)是它具有20到60個(gè)可用的并且可配置的32.75Gbps GTY雙向串行收發(fā)器。下面是一些能夠匹配使用這些收發(fā)器的常用的高速串行接口標(biāo)準(zhǔn)：...
將Zynq SoC上的兩個(gè)ARM Cortex
到目前為止我們摸索使用過的Zynq All Programmable SoC PS（處理器系統(tǒng)）部分的所有設(shè)備都是只利用了一個(gè)ARM Cortex-A9處理器內(nèi)核（內(nèi)核0），然而在Zynq SoC 的PS部分包含有兩個(gè)處理器內(nèi)核，對于很多應(yīng)...
Adam Taylor玩轉(zhuǎn)MicroZed：FreeRTOS
在上一篇博客中成功地演示了FreeRTOS并在基于Zynq的MicroZed板上運(yùn)行之后，顯然我們想要能夠編寫我們自己的應(yīng)用程序。因此，我們將首先舉一個(gè)簡單的例子。我們將配置Zynq SoC的XADC并且在串行鏈...
Adam Taylor玩轉(zhuǎn)MicroZed：MicroZed操作系統(tǒng)
如何獲得FreeRTOS演示并且在MicroZed上運(yùn)行。FreeRTOS由Real Time Engineering公司開發(fā)，為小容量和極快運(yùn)行速度的嵌入式系統(tǒng)提供幫助。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載8：Spartan
Spartan-6的時(shí)鐘緩沖器/多路復(fù)用器（BUFG或BUFPLL）可以直接驅(qū)動(dòng)時(shí)鐘輸入信號(hào)到時(shí)鐘線上，或者通過多路復(fù)用器在兩個(gè)不相關(guān)的信號(hào)甚至異步時(shí)鐘信號(hào)中切換。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載7：Spartan
時(shí)鐘布線資源具有高速、低SKEW的特點(diǎn)，它對系統(tǒng)設(shè)計(jì)非常重要，即使系統(tǒng)速率不高，也應(yīng)該關(guān)注時(shí)鐘設(shè)計(jì)，以消除潛在的時(shí)鐘危險(xiǎn)。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載6：Spartan
Spartan-6的每個(gè)SLICE 有8個(gè)存儲(chǔ)元件，可以實(shí)現(xiàn)存儲(chǔ)功能。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載4：2.1 Spartan
Spartan-6每個(gè)CLB模塊里包含兩個(gè)SLICE。CLB通過交換矩陣和外部通用邏輯陣列相連，如圖2-1和圖2-2所示。底部的SLICE標(biāo)號(hào)為SLICE0，頂部的SLICE標(biāo)號(hào)為SLICE1。兩個(gè)SLICE沒有直接連接。 ...
通過文件讀寫方式實(shí)現(xiàn)Matlab和Modelsim的聯(lián)合仿真的經(jīng)驗(yàn)總結(jié)
雖然Modelsim的功能非常強(qiáng)大，仿真的波形可以以多種形式進(jìn)行顯示，但是當(dāng)涉及到數(shù)字信號(hào)處理的算法的仿真驗(yàn)證的時(shí)候，則顯得有點(diǎn)不足...
基于AXI4的可編程SOC系統(tǒng)設(shè)計(jì)1
現(xiàn)在FPGA越來越被廣泛地應(yīng)用在各個(gè)領(lǐng)域中。Xilinx公司將專用的嵌入式處理器PowerPC硬核、ARM Cortex-A9 MP硬核和嵌入式處理器MicroBlaze軟核嵌入到了FPGA芯片中。這種集成了嵌入式處理器的FPGA芯片被定...
用于 Xilinx FPGA Zynq 7 的電源解決方案
該參考設(shè)計(jì)采用多種 TPS54325 和其他 TI 電源器件，是適用于 Xilinx Zynq FPGA 的全套電源解決方案。輸入電壓達(dá)到 12V 后，該參考解決方案可提供 Zynq FPGA 所需的所有電源軌（包括 DDR3 存儲(chǔ)器）。...
7 FPGA大數(shù)據(jù)互聯(lián)及視頻系統(tǒng)開發(fā)板
Digilent Genesys 2是一款基于Xilinx強(qiáng)大的Kintex-7?FPGA芯片的高性能打開即用型數(shù)字電路開發(fā)平臺(tái)。Genesys 2擁有大容量、高速FPGA、快速外部記憶、高速數(shù)字視頻端口和強(qiáng)大的可擴(kuò)展選項(xiàng)等產(chǎn)品特性，非...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載27：Spartan
Vrtex-6 HXT器件內(nèi)的GTH模塊比GTX有更高的線速率，用它可以實(shí)現(xiàn)最高性能的高速串行收發(fā)器。GTH具有如下特性。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載26：Spartan
Virtex-6支持多種高速串行接口，其中高速串行模塊GTX收發(fā)器可以實(shí)現(xiàn)150Mbit/s～6.5Gbit/s的線速率。GTX收發(fā)器是芯片與芯片之間、板與板之間進(jìn)行串行通信的首選解決方案。GTX收發(fā)器具有以下特性。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載25：Spartan
Virtex-6每個(gè)I/O片（I/O Tile）包含兩個(gè)IOB、兩個(gè)ILOGIC、兩個(gè)OLOGIC 和兩個(gè)IODELAY，如圖5-24 所示。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載24：Spartan
為了適應(yīng)越來越復(fù)雜的DSP運(yùn)算，Virtex-6中嵌入了功能更強(qiáng)大的DSP48E1 SLICE，簡化的DSP48E1模塊如圖5-16所示。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載23：Spartan
Virtex-6中嵌入BRAM，大大拓展了FPGA的應(yīng)用范圍和應(yīng)用的靈活性。BRAM可被配置為單端口RAM、雙端口RAM、內(nèi)容地址存儲(chǔ)器（CAM）以及FIFO等常用存儲(chǔ)結(jié)構(gòu)。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載22：Spartan
除了豐富的時(shí)鐘網(wǎng)絡(luò)以外，Xilinx還提供了強(qiáng)大的時(shí)鐘管理功能，提供更多更靈活的時(shí)鐘。Xilinx在時(shí)鐘管理上不斷改進(jìn)，從Virtex-4的純數(shù)字管理單元DCM，發(fā)展到Virtex-5CMT（包含PLL），再到Virtex-6基于...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載21：Spartan
為了更好的控制時(shí)鐘，Virtex-6器件分成若干個(gè)時(shí)鐘區(qū)域，最小器件有6個(gè)區(qū)域，最大器件有18個(gè)區(qū)域。每個(gè)時(shí)鐘區(qū)域高40個(gè)CLB。在時(shí)鐘設(shè)計(jì)中，推薦使用片上專用的時(shí)鐘資源，不推薦使用本地時(shí)鐘...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載20：Spartan
CLB是實(shí)現(xiàn)時(shí)序電路和組合電路的主要邏輯資源。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載19：Spartan
Virtex-6是Xilinx 在2009年2月推出的新一代旗艦產(chǎn)品，采用了第三代Xilinx ASMBL架構(gòu)、40nm 工藝，提供多達(dá)760000 個(gè)邏輯單元，為業(yè)界成本最低、功耗最低、密度最高、性能最高、帶寬最大的FPGA。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載18：Spartan
Spartan-6 LX平臺(tái)面向邏輯、DSP資源以及存儲(chǔ)模塊進(jìn)行了優(yōu)化，能夠以較低的功耗滿足更高的帶寬和性能需求；而Spartan-6 LXT面向邏輯、DSP以及存儲(chǔ)資源進(jìn)行優(yōu)化，同時(shí)提供低功耗3.125Gbit/s串行收發(fā)器...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載17：Spartan
Spartan-6 FPGA系列為消費(fèi)、汽車、無線和其他價(jià)格敏感或大批量市場，提供了低風(fēng)險(xiǎn)和低成本的串行連接解決方案。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載16：Spartan
Spartan-6器件具有2或4個(gè)專用嵌入式多端口存儲(chǔ)器控制器模塊（MCB），實(shí)現(xiàn)了到4個(gè)常見存儲(chǔ)器標(biāo)準(zhǔn)的簡單連接：DDR3、DDR2、DDR 和LPDDR（移動(dòng)DDR）。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載14：Spartan
為了適應(yīng)越來越復(fù)雜的DSP運(yùn)算，Spartan-6在Spartan 3A DSP模塊DSP48A 基礎(chǔ)上，不斷進(jìn)行功能擴(kuò)展，推出了功能更強(qiáng)大的DSP48A1 SLICE。...
2017-02-11 標(biāo)簽： 1563
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載15：Spartan
所有的Spartan-6 FPGA有高性能的可配置SelectIO驅(qū)動(dòng)器與接收器，支持非常廣泛的接口標(biāo)準(zhǔn)?？梢酝ㄟ^編程控制I/O的輸出強(qiáng)度、斜率以及片上終端OCT。...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載13：Spartan
Spartan-6中的BRAM存儲(chǔ)18Kbit數(shù)據(jù)，能配置成兩個(gè)獨(dú)立的9Kbit BRAM或者一個(gè)18Kbit BRAM。每個(gè)RAM可以通過兩個(gè)端口尋址，也可以配置成單口RAM。BRAM包含輸出寄存器以增加流水線性能。BRAM 在器件中按列排...
Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）連載12：Spartan
Spartan-6 器件最多包含6 個(gè)CMT，12 個(gè)PLL。PLL 的主要用途是作為頻率合成器，產(chǎn)生更寬范圍的頻率輸出，在與CMT 中的DCM 連接時(shí)，具有良好的濾波功能。...
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