可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
基于Arty Artix-35T FPGA開發(fā)板的DDR3和mig介紹
講解xilinx FPGA 使用mig IP對DDR3的讀寫控制，旨在讓大家更快的學(xué)習(xí)和應(yīng)用DDR3。 本實驗和工程基于Digilent的Arty Artix-35T FPGA開發(fā)板完成。 軟件使用Vivado 2018.1。 第一篇：DDR3和mig的介紹 1 DDR3介紹 以鎂...
多用途軟件無線電系統(tǒng)的5G設(shè)計解決方案
本文旨在讓無線電工程師熟悉一種現(xiàn)成的多用途軟件無線電(COTS SDR)平臺，該平臺可以縮短5G的開發(fā)時間。 COTS SDR傳統(tǒng)上一直用于軍用雷達(dá)和通信應(yīng)用中，以獲得高性能和設(shè)計靈活性。最新的CO...
通過Arty Artix-35T FPGA開發(fā)板創(chuàng)建mig IP
講解xilinx FPGA 使用mig IP對DDR3的讀寫控制，旨在讓大家更快的學(xué)習(xí)和應(yīng)用DDR3。 本實驗和工程基于Digilent的Arty Artix-35T FPGA開發(fā)板完成。 軟件使用Vivado 2018.1 第二篇：mig IP的創(chuàng)建 1 DDR3 Digilent的Arty...
基于Xilinx 7系列GTX高速收發(fā)器的初步調(diào)試方案
本來寫了一篇關(guān)于高速收發(fā)器的初步調(diào)試方案的介紹，給出一些遇到問題時初步的調(diào)試建議。但是發(fā)現(xiàn)其中涉及到很多概念。逐一解釋會導(dǎo)致文章過于冗長。所以單獨(dú)寫一篇基本概念的介紹，基...
基于Digilent的Arty Artix-35T FPGA開發(fā)板的DDR3讀寫控制
將通過五篇文章來給大家講解xilinx FPGA 使用mig IP對DDR3的讀寫控制，旨在讓大家更快的學(xué)習(xí)和應(yīng)用DDR3。 本實驗和工程基于Digilent的Arty Artix-35T FPGA開發(fā)板完成。 軟件使用Vivado 2018.1。 參考工程：...
一文詳解Xilinx GTX/GTH及2D eye scan的基本原理
本文介紹Xilinx GT的一些概念，對GT沒有概念但是有時間的童鞋推薦先看一下此文（Xilinx 7系列FPGA 高速收發(fā)器GTX/GTH的一些基本概念），補(bǔ)充一些基礎(chǔ)概念。 隨著高速數(shù)據(jù)傳輸?shù)钠占埃琒erdes已經(jīng)成...
基于ECE-CV K7-75T FPGA開發(fā)板的HDMI視頻流輸入輸出實現(xiàn)方案
本實驗基于ECE-CV K7-75T FPGA開發(fā)板實現(xiàn)。 軟件使用Vivado 2018.1。 基于HDMI的視頻流輸入輸出實驗 1 HDMI概述 HDMI高清多媒體界面（英語：High Definition Multimedia Interface）是一種全數(shù)字化視頻和聲音發(fā)送...
一種彈速補(bǔ)償?shù)腇PGA實現(xiàn)方案解析
來源：電子技術(shù)應(yīng)用ChinaAET 針對高速運(yùn)動平臺彈速補(bǔ)償?shù)膶崟r性要求，在基于距離徙動校正(Range Cell Migration Compensation，RCMC) 的思想上提出了一種彈速補(bǔ)償?shù)腇PGA實現(xiàn)方法。將距離徙動校正的思想...
2020-12-14 標(biāo)簽：FPGA 2831
基于FPGA的實時圖像處理仿真實驗方案實現(xiàn)
對CMOS圖像傳感器采集圖像過程中的噪聲預(yù)處理問題，提出一種在FPGA中實現(xiàn)的可配置的自適應(yīng)加權(quán)均值濾波模塊設(shè)計方案。該模塊通過檢測濾波窗口內(nèi)不同方向的方差來確定紋理方向，從而自動...
7 eries FPGAs SPI MultiBoot實現(xiàn)方式
7 Series FPGAs MultiBoot功能指讓FPGA從2個或者多個BIT文件中加載一個BIT文件運(yùn)行程序，所以它的2個主要應(yīng)用如下： 1. 更新新的BIT時，當(dāng)更新失敗或BIT出錯會返回使用之前好的BIT運(yùn)行程序； 2. 在多個...
FPGA設(shè)計小技巧（時鐘/性能/編程）
時鐘篇 選用全局時鐘緩沖區(qū)（BUFG）作為時鐘輸入信號，BUFG是最穩(wěn)定的時鐘輸入源，可以避免誤差。 只用一個時鐘沿來寄存數(shù)據(jù)，使用時鐘的兩個沿是不可靠的，如果時鐘沿“漂移”，就會導(dǎo)...
2020-12-11 標(biāo)簽：FPGA 2667
FPGA代碼經(jīng)驗 case，casez，casex語句
使用case語句代替嵌套的if-else將會產(chǎn)生更易讀的代碼，更好的邏輯利用率和更高的性能。...
2020-12-11 標(biāo)簽：FPGA 7375
淺析可提升Vivado編譯效率的增量編譯方法
增量編譯：使用增量編譯滿足最后時刻 HDL 變動需求，僅針對已變動邏輯進(jìn)行布局布線，從而可節(jié)省時間。...
2020-12-13 標(biāo)簽：Vivado 6913
基于直方圖算法進(jìn)行FPGA架構(gòu)設(shè)計
引言 直方圖統(tǒng)計在圖像增強(qiáng)和目標(biāo)檢測領(lǐng)域有重要應(yīng)用，比如直方圖均衡，梯度直方圖。直方圖的不同種類和統(tǒng)計方法請見之前的文章。本章就是用FPGA來進(jìn)行直方圖的計算，并且利用FPGA的特性...
5G網(wǎng)絡(luò)在近邊緣和霧天的汽車應(yīng)用
5G的推出是2020年的一個大故事。5G的推動力之一將是改善邊緣，近邊緣和霧天的汽車應(yīng)用。 吉田順子已全面涵蓋了汽車傳感器和自動駕駛汽車的關(guān)鍵方面。正如她所指出的： 但是有一個復(fù)雜之...
2020-12-09 標(biāo)簽：傳感器FPGA微處理器自動駕駛5G網(wǎng)絡(luò) 1446
創(chuàng)建一個ZYNQ的工程和配置的詳細(xì)步驟
新建工程 1. 打開vivado2017.4，在出現(xiàn)的對話框中選擇創(chuàng)建一個工程，如圖所示。這一步是為了創(chuàng)建一個ZYNQ的工程。 2. 點擊創(chuàng)建工程后，出現(xiàn)對話框如圖所示，然后點擊對話框中的下一步。這一步...
2020-12-09 標(biāo)簽：Zynq 7392
ZYNQ開發(fā)案例：GPIO的結(jié)構(gòu)體系及使用案例
GPIO的結(jié)構(gòu)體系 zynq的GPIO，分為兩種，MIO(multiuse I/O)和EMIO(extendable multiuse I/O)。 ZYNQ的GPIO由4個BANK組成，其體系結(jié)構(gòu)如圖1所示。其中Bank0有32個GPIO引腳，Bank1有22個引腳，共54個GPIO引腳直接通過MIO連...
硬件描述語言（HDL）編碼技術(shù)：xilinx verilog語法技巧
xilinx verilog語法技巧 一 硬件描述語言（HDL）編碼技術(shù)讓您： ?描述數(shù)字邏輯電路中最常見的功能。 ?充分利用Xilinx?器件的架構(gòu)特性。 1 Flip-Flops and Registers ： Vivado綜合根據(jù)HDL代碼的編寫方式...
2020-12-13 標(biāo)簽：移位寄存器 4612
基于Arduino和Raspberry Pi開發(fā)板的嵌入式設(shè)計案例
作者：Steve Leibson Arduino 和 Raspberry Pi 開發(fā)板是顛覆嵌入式系統(tǒng)開發(fā)方式的登峰造極之作。從前，嵌入式系統(tǒng)的開發(fā)從硬件開始。項目步驟一般如下： 1. 規(guī)范系統(tǒng)要求，包括粗略估計處理速度和...
2020-12-09 標(biāo)簽：微控制器FPGAled嵌入式系統(tǒng)Arduino 4445
基于MYC-C7Z020 CPU 模塊的MYD-C7Z010 開發(fā)板應(yīng)用
MYD-C7Z020 開發(fā)板的構(gòu)建基于 MYC-C7Z020 CPU 模塊，該模塊是一款基于 ZYNQ 的、Linux 就緒型的小巧 SOM，全面結(jié)合 Xilinx XC7Z020-1CLG400C SoC 器件、1GB DDR3 SDRAM、4GB eMMC、32MB 四路 SPI 閃存、千兆位以太網(wǎng) PH...
Xilinx ZCU104實現(xiàn)視頻處理和傳輸系統(tǒng)方案
本階段ISP實現(xiàn)基本功能,主要包括：Demosaic、CCM、3A、Dpc、Gamma、Denoise、Enhance等基本內(nèi)容，ISP需保證對輸入圖像實時處理。...
同步時序電路需要考慮的三個重要的時序參數(shù)
對于絕大部分的電路來說輸出不僅取決于當(dāng)前的輸入值，也取決于原先的輸入值，也就是說電路具有記憶功能，這屬于同步時序電路。...
Xilinx開發(fā)板ZCU104對接驗證接口板電路原理圖
作者：Hello，Panda 連載［第三篇］講過，要設(shè)計一塊接口板和Xilinx官方開發(fā)板ZCU104對接來做驗證。接口板有兩塊，分別是相機(jī)板和擴(kuò)展板，相機(jī)板搭載Sony IMX172/117傳感器；接口板包括FMC插座、萬...
信號完整性仿真實驗：Hyperlynx?調(diào)用及兩種仿真工作流程
在這篇文章中，我們將介紹如何調(diào)用 Hyperlynx、如何設(shè)置簡單的原理圖以及如何運(yùn)行一些基本的仿真操作。Hyperlynx 可支持下列兩種仿真工作流程。 LineSim： 用來預(yù)布局仿真，是設(shè)計周期中的早期...
2020-12-05 標(biāo)簽：PCB設(shè)計信號完整性 8563
ZYNQ開發(fā)案例之DMA控制器系統(tǒng)設(shè)計
1. DMA外設(shè)特點： 1. DMA引擎擁有一個靈活的指令設(shè)置DMA的傳輸； 2. 擁有8個cache線，每一個cache線寬度是4個字； 3. 擁有8個可以并行的DMA通道線程； 4. 擁有8個中斷給中斷控制器； 5. 擁有8個DMA觸發(fā)...
2020-12-05 標(biāo)簽：dmaDDR內(nèi)存dma 5548
ZYNQ開發(fā)雙核運(yùn)行原理及過程
ZYNQ是一個可擴(kuò)展平臺，就是有FPGA作為外設(shè)的A9雙核處理器，它的啟動流程與FPGA完全不同，而與傳統(tǒng)的ARM處理器類似，ZYNQ的啟動配置需要多個處理步驟。...
2020-12-05 標(biāo)簽：Zynq 7026
ZYNQ開發(fā)案例之ZYNQ的UART加載
加載方法 ZYNQ的啟動鏡像是由FSBL程序（bootloader），PL配置文件（硬件比特流文件），應(yīng)用層軟件三個部分組成，其通過SDK的軟件生成工具把三個部分按規(guī)定的格式拼湊成一個.bin文件，最終將這...
三張圖解析FPGA/ACAP在AI推理中的優(yōu)勢
三張圖 在Xilinx官網(wǎng)找資料無意中在應(yīng)用AI推斷加速中看到了下面三張圖，頓覺眾里尋他千百度,驀然回首,那人卻在燈火闌珊處的意思了。三張圖非常通俗易懂的介紹了FPGA/ACAP這樣的體系結(jié)構(gòu)在...
Vivado設(shè)計中生成VPSS時出現(xiàn)的常見問題解析
在 Vivado 設(shè)計中，最重要的是要看來自 VPSS 的復(fù)位信號（該信號控制上游 (TPG) 和下游 (AXI4S 到視頻輸出) IP）。...
2020-12-04 標(biāo)簽：FPGAusb操作系統(tǒng) 3378
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