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可編程邏輯

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FPGA實現(xiàn)路由、MAC層協(xié)議的困難在哪里？

2018-07-25 標(biāo)簽：ARM Power PC

FPGA算圓周率結(jié)果

2018-07-25 標(biāo)簽：算法

求助?。‰妷罕容^器與FPGA連接問題

2018-07-24 標(biāo)簽：比較器

基于賽靈思FPGA的EtherCAT主站運動控制

2018-07-23 標(biāo)簽：Xilinx

IAR for 430的使用，請問左側(cè)的.c,,,.h文件有什么用？怎么創(chuàng)建新的.h文件？

2018-07-22

大神用VHDL寫的uart_rx模塊，沒看明白，請問是在哪里接收的數(shù)據(jù)？cnt是什么？

2018-07-20 標(biāo)簽：UART VHDL源碼

2018-07-19

2018-07-19

2018-07-19

2018-07-19

Quartus無法創(chuàng)建IP核，在生成的時候報錯，求救99999

2018-07-18 標(biāo)簽：caffe框架 IP核

fpga時序約束教程

2018-07-18

請問IC設(shè)計中讀寫電路的設(shè)計中如何實現(xiàn)讀寫和連續(xù)讀寫兩種方式？

2018-07-18 標(biāo)簽：IC設(shè)計

Quartus Prime 精簡版都是免費的么？

2018-07-18 標(biāo)簽：QUARTUS caffe框架

virtuoso仿真出現(xiàn)ERROR (OSSHNL-514)，該怎么解決？

2018-07-17 標(biāo)簽：仿真 Virtuoso

請好心人幫我看下錯誤出現(xiàn)在哪

2018-07-17

學(xué)好FPGA，輕松快速實現(xiàn)工程夢

2018-07-16

為FPGA 設(shè)計電源管理，有幾點要素要牢記！

2018-07-16

asic設(shè)計

2018-07-16 標(biāo)簽：RT-Thread ASIC

《通過uart協(xié)議理解何為接口設(shè)計何為模塊化設(shè)計（封裝）》含程序和視頻

2018-07-16 標(biāo)簽：UART

Verilog數(shù)字系統(tǒng)設(shè)計教程

2018-07-16 標(biāo)簽：Verilog 車牌定位圖像

logic [7:0] mem [7:0] 在system verilog中是什么意思？

2018-07-14 標(biāo)簽：FPGA Verilog 車牌定位

QuestaSim 10.1下載

2018-07-13 標(biāo)簽：questasim

關(guān)于FPGA的{12 - color_width{1'b0}} 是什么意思？

2018-07-12

FPGA碼代碼非常好用的編輯軟件-Gvim

2018-07-12 標(biāo)簽：gVim

Virtex-6 ml605以太網(wǎng)接口問題

2018-07-12

spartan-6功耗如何確定

2018-07-12 標(biāo)簽：Spartan-6 功耗

有關(guān)FPGA的配置的問題？

2018-07-11

vivado破解版下載

2018-07-11 標(biāo)簽：ISE vivado 時鐘

xilinx FFT ip核仿真的誤差太大？

2018-07-10 標(biāo)簽：FFT ARM IP核

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